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0(1+3c)p1,且时间超过1s3.3策略为回路的结构组成示意图由电容C3分压的电压K进入回路的前置处理模块,包括PT测量电压、有源低通滤波和电压真有效值的;将电压的真有效值输入判断模块,通过与预设的基准电压M进行比较后,由延时判断逻辑电路检测输入电平的时间是否有效;其输出的电平后被输入模块,若此输入分/合闸触发电路工作的要求,触发电路会给开关器发出触发,使间隙分/合闸可控间隙回路的策略见表2.表2可控。
CXD90010G
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